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4-40
PLL Reconfiguration and Dynamic Phase Shift
SV51005
2014.01.10
? The VCO frequency gradually decreases when the current clock is lost and then increases as the VCO
locks on to the backup clock, as shown in the following figure.
Figure 4-39: VCO Switchover Operating Frequency
Primary Clock Stops Running
Switchover Occurs
? Fvco
VCO Tracks Secondary Clock
PLL Reconfiguration and Dynamic Phase Shift
For more information about PLL reconfiguration and dynamic phase shifting, refer to AN661.
Related Information
AN661: Implementing Fractional PLL Reconfiguration with ALTERA_PLL and
ALTERA_PLL_RECONFIG Megafunctions
Document Revision History
Date
January 2014
Altera Corporation
Version
2014.01.10
Changes
? Removed Preliminary tags for clock resources, clock input pin
connections to GCLK and RCLK networks, and PLL features tables.
? Updated information on dual-regional clock region.
? Added label for PLL strip in PLL locations diagrams.
? Added descriptions for PLLs located in a strip.
? Updated VCO post-scale counter, K , to VCO post divider.
? Added information on PLL cascading.
? Added information on programmable phase shift.
? Updated automatic clock switchover mode requirement.
Clock Networks and PLLs in Stratix V Devices
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